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數字邏輯
高等教育出版社
本書第一版是“教育部面向21世紀教學內容和課程體系改革”的研究成果，被列入教育部面向21世紀課程教材、“九五”國家級重點教材。第二版被列為“十一五”國家級重點教材。本書著重介紹數字系統邏輯設計的基本理論和方法，同時對數字技術的新成果和新方法作了適當介紹。本書系統地闡述了以下內容：數制與編碼，邏輯代數基礎，組合邏輯電路和時序邏輯電路的分析與設計，數字系統設計，自動邏輯綜合，邏輯模擬與測試，硬體描述語言Verilog HDL，以及邏輯器件。本書可作為計算機類、電子類、自動化類相關專業的教材，也可作為有關專業工程技術人員的參考書。
本書第一版是“教育部面向21世紀教學內容和課程體系改革”的研究成果，被列入教育部面向21世紀課程教材、“九五”國家級重點教材。第二版被列為“十一五”國家級重點教材。
目 錄
第一章 數制與編碼
1.1 進位計數制
1.2 數制轉換
1.3 帶符號數的代碼表示
1.4 數的定點表示和浮點表示
1.5 數碼和字元的代碼表示
第二章 邏輯代數基礎
2.1 邏輯代數的基本概念
2.2 邏輯代數的公理、定理及規則
2.3 邏輯函數表達式的形式與轉換
2.4 邏輯函數的化簡
第三章 組合邏輯電路
3.1 邏輯門電路
3.2 邏輯函數的實現
3.3 組合邏輯電路的分析
3.4 組合邏輯電路的設計
3.5 組合邏輯電路的競爭與冒險
第四章 同步時序邏輯電路
4.1 同步時序邏輯電路模型
4.2 觸發器
4.3 同步時序邏輯電路分析
4.4 同步時序邏輯電路設計
4.5 同步時序邏輯電路設計舉例
第五章 非同步時序邏輯電路
5.1 非同步時序邏輯電路模型
5.2 脈衝非同步時序邏輯電路分析和設計
5.3 電平非同步時序邏輯電路分析和設計
5.4 電平非同步時序邏輯電路的競爭與冒險
5.5 電平非同步時序邏輯電路設計舉例
第六章 採用中、大規模集成電路的邏輯設計
6.1 二進位并行加法器
6.2 數值比較器
6.3 解碼器
6.4 多路選擇器
6.5 計數器
6.6 寄存器 6.7 只讀存儲器
6.8 可編程邏輯陣列
6.9 可編程陣列邏輯
6.10 通用陣列邏輯
6.11 高密度可編程邏輯器件
第七章 數字系統設計
7.1 概述
7.2 數字系統的描述
7.3 基本數字系統設計
7.4 簡易計算機設計
第八章 自動邏輯綜合
8.1 多維體表示
8.2 多維體的基本運算
8.3 多維體運算的計算機實現
8.4 組合邏輯電路的計算機輔助邏輯設計
8.5 同步時序邏輯電路的計算機輔助邏輯設計
第九章 邏輯模擬與測試
9.1 邏輯模擬的模型
9.2 邏輯模擬演演算法
9.3 故障模擬
9.4 邏輯電路的測試
9.5 可測性設計
第十章 Verilog HDL語言
10.1 概述
10.2 Verilog HDL語言基本要素
10.3 Verilog HDL語言的基本語句
10.4 Verilog HDL語言的其他結構
10.5 Verilog HDL設計方法
第十一章 邏輯器件
11.1 二極體及三極體的開關特性
11.2 三極體反相器
11.3 典型集成TTL“與非”門電路
11.4 其他類型TTL“與非”門電路
11.5 MOS集成門電路
11.6 數字集成電路分類、性能及器件名稱
參考文獻
第一章 進位與編碼
第二章 邏輯代數基礎
第三章 組合邏輯電路
第四章 同步時序邏輯電路
第五章 非同步時序邏輯電路
第六章 採用中、大規模集成電路的邏輯設計
第七章 數字系統設計
第八章 自動邏輯綜合
第九章 邏輯模擬與測試
第十章 Verilog HDL語言
第十一章 邏輯器件
參考文件
